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BELLEII实验高速数据接收板的设计
作者： 赵京周 [1,2,3] ; 刘振安 [1,3] ; 孙德晖 [1,2,3] ; 徐昊 [1,3] ; 王强 [1,3]
摘要：在高能物理实验中,随着加速器和探测器性能的提高,数据获取系统正面临着越来越大的海量数据实时可靠传输的挑战。BELLEII探测器是运行在SuperKEKB高亮度加速器上的新型探测器,其数据获取系统也面临这一难题。基于FPGA的高速数据接收模块（HSLB）作为数据获取系统的数据传输核心,采用RocketIO技术实现高速串行数据传输,满足速率3.125 Gbps的设计要求;与专用接口连接的CPLD作为控制芯片在线配置FPGA固件,提供快速硬件程序加载,高速链路共享,高速数据传输和慢控制命令传输的功能。论文详细描述了高速数据传输模块的硬件设计、在线配置FPGA的实现方案。经过测试,该模块成功实现设计目标,并已经按工程进度进行了小批量生产。
关键字： Belle2Link 数据获取系统 高速数据传输 RocketIO 在线配置